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Verilog HDL의 기초와 디지털 논리회로 설계 - Altera Quartus Ⅱ & Max + Plus Ⅱ를 이용한

백주기(지은이) 성안당 2008-03-28

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[중고] Verilog HDL의 기초와 디지털 논리회로 설계
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